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[IT뉴스]래티스반도체, AMD·알테라에 도전장...신규 FPGA 칩 성능·보안 강화

온카뱅크관리자

2026-09-17 11:07:25

<div id="layerTranslateNotice" style="display:none;"></div> "AIDC 시장 공략…내장 플래시 메모리, PQC 지원 등 경쟁력 갖춰" 
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 (지디넷코리아=장경윤 기자)미국 래티스반도체가 인공지능(AI) 데이터센터 등 첨단 산업을 위한 신규 필드프로그래머블게이트어레이(FPGA)를 선보인다. AMD·알테라 등 경쟁사 대비 빠른 부팅 속도와 차세대 보안 기술을 탑재한 것이 특징이다. 현재 복수 고객을 상대로 샘플 공급을 추진 중이다. 
 래티스반도체는 지난 15일 온라인 간담회를 열고 신규 FPGA 하드웨어 및 설계 소프트웨어 제품을 공개했다. 
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 <img alt="래티스반도체가 신규 출시한 보안 제어 FPGA '마크(Mach)-N2'(사진=래티스반도체)" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202609/17/ZDNetKorea/20260917110152470hbli.png" data-org-width="638" dmcf-mid="uUcd51yOkY" dmcf-mtype="image" height="auto" src="https://img2.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202609/17/ZDNetKorea/20260917110152470hbli.png" width="658">
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 래티스반도체가 신규 출시한 보안 제어 FPGA '마크(Mach)-N2'(사진=래티스반도체)
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 래티스는 간담회에서 소형 FPGA 플랫폼 '래티스 넥서스(Lattice Nexus) 2'의 신규 제품 '마크(Mach)-N2'를 출시했다. FPGA는 엔지니어가 내부 회로 구조를 원하는 방식으로 바꿀 수 있는 반도체다. 반도체 샘플 검증부터 통신, 데이터센터, 차량 등 등 다양한 산업에서 활용되고 있다. 
 마크-N2는 전 세계 사이버 공격이 증가하는 추세에 맞춰 래티스가 내놓은 비휘발성 보안 제어 FPGA다. 최대 7.8Gbps 데이터 통신 인터페이스(MIPI D-, C-PHY)를 지원하며, 저전력에서 2배 더 빨라진 프로그래머블 패브릭 속도를 갖췄다.
 업계 선도적인 보안 기술도 적용했다. 마크-N2는 암호화 유연성을 비롯해, 양자 컴퓨터 공격에 저항하는 암호화 알고리즘 '양자내성암호(PQC)'를 지원한다. 부팅 속도는 30밀리초(ms) 이내다. 해당 속도가 빨라야 해킹 위험으로부터 칩을 안전히 보호할 수 있다.
 빠른 부팅 속도를 가능케 하는 비결은 '통합 플래시메모리'에 있다. 이기훈 래티스 이사는 "통상 FPGA는 플래시 메모리가 외부에 있어 데이터를 읽는 데 시간이 걸렸으나, 래티스 제품은 플래시 메모리를 칩 내부에 통합해 처리속도를 높였다"며 "칩이 외부에 노출되지 않아 해킹 위협도 차단할 수 있다"고 설명했다. 
 래티스는 마크-N2 장점을 무기로 AI 데이터센터, 네트워크 인프라, 에지 디바이스, 휴머노이드 등 첨단 산업을 공략한다. 곧 일부 고객에 샘플을 제공할 계획인 것으로 알려졌다. 
 AMD, 알테라 등 FPGA 업계 선도업체들과 경쟁 구도가 주목된다. 경쟁사 제품 부팅 속도는 200ms 이상으로, 래티스 대비 크게 느리다. PQC 서비스를 제공하는 칩 역시 래티스가 유일하다. 특히 PQC는 세계 각국에서 향후 3~5년 내 데이터센터 적용을 서두르고 있어, 향후 시장 규모가 커질 것으로 기대된다.
 이 이사는 "서버 시장에서 마크-N2의 정확한 공급 시점을 밝히기 어렵지만, 고객사 수요를 확인한 만큼 이미 적용이 예정돼 있다고 보면 된다"고 말했다.
 또한 래티스반도체는 AI 기반 FPGA 설계 지능형 소프트웨어 툴 '래티스 프롬프트(Lattice Prompt)'를 출시했다. 해당 도구는 엔지니어가 자연어나 파이썬, C-코드를 입력하면 AI가 FPGA 전용 하드웨어 설계 언어(VHDL, 베릴로그 등)로 자동 변환해 준다. 이를 통해 기존 약 4개월(120일)이 소요되던 복잡한 설계 및 타이밍 맞추기 작업을 10~12일 수준으로 단축했다. 
 장경윤 기자(jkyoon@zdnet.co.kr)
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