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[IT뉴스][ISMP 2026]HBM 한계 돌파…SK하이닉스 '면적 희생' vs 삼성전자 '시스템 동시 최적화'
온카뱅크관리자
조회:
7
2026-11-05 14:17:26
<div id="layerTranslateNotice" style="display:none;"></div> <div class="article_view" data-translation-body="true" data-tiara-layer="article_body" data-tiara-action-name="본문이미지확대_클릭"> <section dmcf-sid="7bls8Kx2ry"> <figure class="figure_frm origin_fig" contents-hash="b7af046b1a454fadd043d53143bdcd4aa33a5875a5402a9746d2efcb2e9893bb" dmcf-pid="zZjLp5ztOT" dmcf-ptype="figure"> <p class="link_figure"><img alt="박지용 SK하이닉스 패키징혁신 담당 부사장" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202611/05/etimesi/20261105141241308jfwp.jpg" data-org-width="700" dmcf-mid="UEhgutB3rY" dmcf-mtype="image" height="auto" src="https://img4.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202611/05/etimesi/20261105141241308jfwp.jpg" width="658"></p> <figcaption class="txt_caption default_figure"> 박지용 SK하이닉스 패키징혁신 담당 부사장 </figcaption> </figure> <p contents-hash="1758cdbab789109fd9d129d23e5130002829d64ad46d3ce35e04d92d26c02151" dmcf-pid="q5AoU1qFwv" dmcf-ptype="general">고대역폭메모리(HBM) 시장의 주도권을 쥐고 있는 SK하이닉스와 삼성전자가 초고단 적층 시대의 고발열·고수율 난제를 돌파하기 위해 각기 다른 전략적 승부수를 던졌다.</p> <p contents-hash="def0af92e0fab67fd8b1739ec22020382a1fae8316781f0129ff13efeb951fec" dmcf-pid="B1cgutB3ES" dmcf-ptype="general">5일 한국마이크로전자및패키징학회 주최 국제학술대회 'ISMP 2026' 기조연설에서 SK하이닉스는 칩 설계 면적까지 양보하는 '아키텍처 공동 설계(STCO)'를, 삼성전자는 메모리·로직·광학을 아우르는 '시스템 레벨 공동 최적화(SCU)'를 각각 해법으로 제시하며 첨단 패키징 진화의 방향성을 명확히 했다.</p> <p contents-hash="f1da36e193ce7f83a8ca1ef2f5e2aebcc51f8729e24b3fb11afba57b663450b6" dmcf-pid="btka7Fb0Ol" dmcf-ptype="general">박지용 SK하이닉스 패키징혁신 담당 부사장은 HBM 고단 적층에 따른 발열 해법으로 '메모리 내부 방열 구조 이식'과 '설계 트레이드오프(Trade-off)'를 화두로 던졌다.</p> <p contents-hash="2e8c5b54a0496bf6cb9f533fc048812dbecee9df495e85bb9bde2c1e7ba17431" dmcf-pid="KFENz3KpEh" dmcf-ptype="general">박 부사장은 베이스 다이 내부 물리계층(PHY) 영역 등의 국소 핫스팟(Local Hotspot)을 잡기 위해 “해당 영역 바로 위에 고열전도 구조물을 배치해 열을 빼내는 '열 방출 고속도로'를 구축하고 있다”고 밝혔다.</p> <p contents-hash="93dd1b4cf02385d93b2988457391d8d5977d3b8c02b5fb04bbe204f5f498b207" dmcf-pid="93Djq09UsC" dmcf-ptype="general">특히 “이를 위해 귀중한 실리콘 면적 일부를 물리적으로 포기하고 방열 경로로 전용해야 하는 트레이드오프를 감수하고 있다”며 방열 대책이 칩 내부 설계 면적을 양보하는 아키텍처 차원으로 진화했음을 강조했다.</p> <p contents-hash="938d1cc93a04af986f59efec811283c5c6f386cdeab21c1a5ce3fb1d0fffdaec" dmcf-pid="2QZWixgRsI" dmcf-ptype="general">이어 3차원(3D) HBM-로직 직접 집적과 관련해서는 “수직 적층은 열 문제를 악화시키고 수율 급락 등 냉혹한 현실이 존재한다”며 철저한 양품 다이(KGD) 테스트의 중요성을 역설했다.</p> <p contents-hash="77aab66070972a4c55c9a021ad8c4e70bb6807ada62275645b3d77d8a9f35e89" dmcf-pid="Vx5YnMaemO" dmcf-ptype="general">이를 돌파하기 위해 소자부터 시스템까지 하나로 묶는 디바이스-기술 공동최적화(DTCO) 및 시스템-기술 공동최적화(STCO) 체제로 무게중심을 옮기며, “패키징이 단순히 칩을 조립하는 단계를 넘어 아키텍처 형태 자체를 빚어내는 시대가 됐다”고 선언했다.<br></p> <figure class="figure_frm origin_fig" contents-hash="cbbc30252ff53cde20abc6cf8fcc1f61011f21b8ec4c52506f2b160a48c00070" dmcf-pid="fM1GLRNdIs" dmcf-ptype="figure"> <p class="link_figure"><img alt="최원경 삼성전자 반도체연구소 차세대 패키지랩 상무(VP)" class="thumb_g_article" data-org-src="https://t1.daumcdn.net/news/202611/05/etimesi/20261105141242580ecsi.jpg" data-org-width="700" dmcf-mid="uc4KhrTsmW" dmcf-mtype="image" height="auto" src="https://img3.daumcdn.net/thumb/R658x0.q70/?fname=https://t1.daumcdn.net/news/202611/05/etimesi/20261105141242580ecsi.jpg" width="658"></p> <figcaption class="txt_caption default_figure"> 최원경 삼성전자 반도체연구소 차세대 패키지랩 상무(VP) </figcaption> </figure> <p contents-hash="a1fff42c801065fb94d76f333bfcfe25a0edb712d4d1db07f457663200794e08" dmcf-pid="4RtHoejJwm" dmcf-ptype="general">바통을 이어받은 최원경 삼성전자 반도체연구소 차세대 패키지랩 상무(VP) 시선을 HBM 메모리 내부를 넘어 로직, CPU, 광학 엔진까지 결합한 '메가 시스템 인프라' 관점으로 확장했다.</p> <p contents-hash="5403c51335608aca395feb660577dbafa4adf8553d870f777714afd74341fb1d" dmcf-pid="8eFXgdAirr" dmcf-ptype="general">최 부사장은 에이전틱 AI 시대를 맞아 하드웨어 인프라 요구 조건이 완전히 변했다고 진단하며, 칩렛 구조에서 열이 갇히는 문제를 해결하기 위한 해법으로 역시 'STCO'를 전면에 내세웠다.</p> <p contents-hash="6f09be6a9f43fe2ca471fe323b99e714aeea0253d1776fcf3a6d9d98894b5605" dmcf-pid="6d3ZaJcnmw" dmcf-ptype="general">그는 “다이 디자인 초기 단계부터 상하부 양면 방열과 3D PCD(접합부 열저항 제어) 기술 등 제약 조건을 고려하지 않으면 막판에 대대적인 리디자인 위험에 직면한다”며, 설계 단계부터 시스템 레벨 최적화가 선행되어야 함을 역설했다.</p> <p contents-hash="9ba85e3e68d6e26d20680f112b70cfc2c08b998299201932c97c0f892f00cdae" dmcf-pid="PPXyJQoMmD" dmcf-ptype="general">하이브리드 본딩 도입 전략에 대해서도 실무적 현실을 가감 없이 짚었다. 최 부사장은 하이브리드 본딩 개발 과정에서 '파티클(이물) 제어'와 '보이드(빈공간) 방지'가 극단적 난제임을 토로하며, 시장 진입 초기에는 수율과 비용 안정을 위해 TC 본딩(열압착 방식)을 우선 적용하는 투트랙(Two-track) 실용 노선을 취하고 내년(2027년)까지 양산 검증을 완료하겠다고 밝혔다.</p> <p contents-hash="89a7251e93f2f51cceb2de716e7eee24d2b58f0e754f1da3aa1a3f0a9c37eb52" dmcf-pid="QQZWixgRIE" dmcf-ptype="general">아울러 전통적 구리 배선의 물리적 한계를 극복하기 위해 3D TCD 광학 엔진(실리콘 포토닉스·CPO) 시연 성과를 공개하며 초고속 볼륨 응용 시장을 겨냥한 토탈 솔루션 비전을 제시했다. 최 부사장은 “초고성능 AI 시대를 여는 최적의 솔루션을 제공하기 위해 고객사 및 생태계 파트너들과의 긴밀한 공동 전선을 더욱 강화해 나갈 것”이라고 말했다.</p> <p contents-hash="4521948a2dd2e510707b1835dd0c1d51e94e2e5c858d41ea1e0467e91e407ab8" dmcf-pid="xx5YnMaemk" dmcf-ptype="general">이형두 기자 dudu@etnews.com</p> </section> </div> <p class="" data-translation="true">Copyright © 전자신문. 무단전재 및 재배포 금지.</p>
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